导图社区 组合逻辑电路
数字电路根据逻辑功能的不同特点,可以分成两大类,一类叫组合逻辑电路(简称组合电路),另一类叫做时序逻辑电路(简称时序电路)。组合逻辑电路在逻辑功能上的特点是任意时刻的输出仅仅取决于该时刻的输入,与电路原来的状态无关。本图总结了相关知识。
集成电路(integrated circuit)是一种微型电子器件或部件。采用一定的工艺,把一个电路中所需的晶体管、电阻、电容和电感等元件及布线互连一起,制作在一小块或几小块半导体晶片或介质基片上,然后封装在一个管壳内,成为具有所需电路功能的微型结构;
CMOS逻辑电路代表互补的金属氧化物半导体(Complementary Metal-Oxide-Semiconductor),它指的是一种特殊类型的电子集成电路(IC)。
这是一篇关于自控力的思维导图,当我们将意志力挑战看成是衡量道德水平的标准时,善行就会允许我们做坏事。为了更好地自控,我们需要忘掉美德,关注目标与价值。
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D服务费结算
材料的力学性能
总平面图知识合集
软件项目流程
一级闭合导线
建筑学建筑材料思维导图
第二章土的物理性质及工程分类
人工智能的运用与历史发展
电池拆解
组合逻辑电路
编码器
Def:区分一系列不同事物,将其中每个事物用一个二进制表示
功能:将输入的每个高/低电平信号变成一个对应的二 进制代码
分类
按转换
二进制编码器
二—十进制编码器
按优先级
普通编码器
特点:任何时刻只允许输入一个有效编码信号,否则输出将发生混乱
工作原理:用 n 位二进制代码对相应的 N = 2n 个信号进行编码的电路
实例:8线-3线编码器
真制表:
优先编码器
允许几个信号同时输入,但只对优先级别最高的进行编码。 优先顺序:I7->I0
实例
74HC148
真值表: (YS',YEX'用以判断工作状态)
attention
将I9~ I0十个输入信号分别编成10个BCD代码
I9的优先权最高, I0的优先权最低
Y3~ Y0为四位二进制BCD码的输出端
二-十进制优先编码器74HC147
真值表:
将 I9~I0编成0110 ~ 1110
I9 的优先权最高,I0最低
输入的低电平信号变成一个对应的十进制的编码
译码器
Def:将每个输入的二进制代码译成对应的输出高、低电平信号。
74HC138——CMOS门电路组成的3线-8线译码器
将两个74HC138可组成 4线-16线译码器
显示译码器
记忆方法:顺时针1圈,a~f;最后是中间的g
给出4个输入,判断输出:先用“8421”法译出应显示的数字,然后对应找亮的点。
数据选择器设计逻辑电路
4选1数据选择器
Step:1,先把输出为一整理为相乘项为1之和之形式 2,提出一个指定的因子,把相同的合并,待会因子作为地址端数据 3,把提出的因子作为地址端(A)的输入,其余为数据端(D)输入
书p182例4.5.4
8选1数据选择器
Step:1,把相乘和式化为所有最小项之和的形式,依次在前面乘上D0~D7(从小到大,用“8421”比) 2,为1者,对应乘之D为1;为零者,对应为零。 3,地址端(A)分别为输入的变量,数据端(D)为前面分析出的“01”高低电平。
书p182例4.5.5
1. 若要产生单输出逻辑函数时, 可先考虑数据选择器。 2. 用n位地址输入的数据选择器,可以产生任何一种输入变量数不大于n+1的组合逻辑函数。 3. 设计时可以采用函数式比较法。控制端作为输入端,数据输入端可以综合为一个输入端
加法器
半加器:两个 1 位二进制数相加不考虑低位进位
函数表达式
CO为进位端
两位二进制数相加,求二进制结果
全加器:将两个1位二进制数及来自低位的进位相加
多位加法器
串行进位加法器 (采用伋连之方式)
特点:电路简单,连接方便;但速度低
改进:超前进位加法器
数据选择器
在数字信号的传输过程中,从一组数据中选出某一个来送到输出端
实例:74HC153
功能:双4选1数据选择器
真值表
改造
用双4选1数据选择器74HC153组成8选1数据选择器。
方法论:“八选一”的八个数据需要3位地址代码。 故利用S0做为第3位地址输入端
改造效果
改造后的函数表达式:
实际应用的改造
方法论:若将A1、A0作为两个输入变量,D10~D13为第三个变量的输入或其他形式,则可由4选1数据选择器实现3变量以下的组合逻辑函数。
数值比较器