导图社区 数电第五章--触发器
数电第五章，详细总结了基本触发器，同步触发器。同步D触发器，边沿触发器的内容。图文结合，帮助小伙伴快速掌握数电的内容！
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触发器
基本触发器
逻辑电路图
0状态：Q=0、Q反= 1的状态定义为0状态
1状态：Q=1、 Q反=0的状态定义为1状态
特性表
特性方程
同步触发器
同步RS触发器
CP称为时钟脉冲，是输入控制信号
CP=0时控制门G3、G4被封锁，基本触发器保持原来状态不变 CP=1时控制门被打开后，输入信号才会被接受
主要特点
1、时钟电平控制
在CP=1期间触发器接受输入信号，CP=0时触发器保持状态不变，多个这样的触发器可以在同一个时钟脉冲控制下同步工作。
2、R、S之间有约束
在RS触发器的基础上多加了两个非门分别与G1,G2相连
同步D触发器
1、时钟电平控制，无约束问题
2、cp=1时跟随，下降沿到来时才锁存
集成同步D触发器
TTL集成同步触发器
CMOS集成同步触发器
控制CP是高电平有效还是低电平有效 POL=1,CP高电平有效，反之，低电平有效
在同步RS触发器的基础上加了一个反向器
边沿触发器
边沿D触发器
用两个同步D触发器级联起来构成边沿D触发器 具有主从结构形式的边沿D触发器，由两个同步 D触发器组成，主触发器受cp操作，从触发器用 CP反管理
CP下降沿到来时，将封锁门G7,G8，打开门G3、G4，主触发器锁存CP下降时刻D的值，随后该值被送入从触发器
同步输入端
D叫做同步输入端。因为加在D端的输入信号能否进入触发器而被接受， 是受时钟脉冲同步控制的
异步输入端
Rd反、Sd反叫做异步输入端，也称之为直接复位和置位端。Rd发表=1，触发器复位到0状态；Sd反=0时，触发器被置位到1状态。其作用与时钟CP无关。
抗干扰能力极强，只要边沿触发
边沿JK触发器
与边沿D触发器相比，增加了三个门G1、G2、G3
总结：CP下降沿时刻有效。J、K不同服从J,都为0保持，都为1取反
主要有特点
1、时钟脉冲边沿控制 2、抗干扰能力极强，工作效率很高 3、功能齐全（具有保持、置0、置1、翻转）
边沿触发器的功能分类
JK触发器
D型触发器
T型触发器
J=K=T，JK触发器就会变成T型触发器
在时钟脉冲操作下，根据输入信号的T取值不同，凡是具有保持和翻转功能电路，即当T=0时能保持状态不变，T=1时一定翻转电路
只有保持和翻转功能
T'触发器
J=K=1-->T'若令T触发器中的T=1就成了T'出啊发起
凡是每来一个时钟就翻转一次电路
只有翻转功能
成员： 蒋照波 雷嘉玲 赵慧娜 邓侣 李欣欣 初子敬
通信工程2003班第4组
为什么要用同步D触发器
R、S之间有约束限制了同步RS触发器的使用，为了解决这个问题
为什么要用同步RS触发器
由于RS同步触发器抗干扰能力差，不便于多个触发器同步工作
RS触发器
主要优点
结构简单，只要把两个与非门或者或非门交叉连接起来即可，是触发器的基础结构形式
具有置0、置1和保持功能
错在问题
电路抗干扰能力下降
R、S之间有约束
逻辑符号
(b） 图是基本RS触发器的逻辑符号 方框下面输入端处有个小圆圈代表 低电平有效
触发器的现态和次态
现态：接收输入信号之前的状态
次态：接收输入信号之后的状态
基本要求
应该是有两种稳定的状态——0状态和1状态，以表征其储存内容
能够接收、保存和输出信号
